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CADENCE数字IC设计平台助GUC完成台湾首个65纳米芯片设计

2007-03-14      嵌入式在线      收藏 | 打印
    全球电子设计创新的领导者Cadence设计系统公司 (NASDAQ: CDNS)最近宣布,领先的系统级芯片(SoC)设计代工公司创意电子Global Unichip Corporation (GUC; TW:3443)完成了中国台湾地区第一个65纳米器件的成功出带。此次65纳米出带的成功进一步加强了GUC服务于全球顶级客户的先进技术能力。GUC使用了Cadence? Low-Power Solution和SoC Encounter? GXL RTL-to-GDSII系统来完成此次出带。

    “以65纳米工艺技术为目标是当前半导体设计的潮流,”GUC公司总裁兼首席运行官(COO)Jim Lai表示,“成功达到目标需要紧密集成的设计环境和自动化的低功耗设计方法学。GUC具有先进工艺设计的全面专门技巧,采用了Cadence Low-Power Solution和Encounter 平台来进行该超过1千万门的低功耗设计,7周内就完成了实现,从而帮助GUC的客户获得了明显的上市时间优势。”

    本次GUC出带涉及预定面向生产的一项定制设计。GUC采用了Cadence的SoC Encounter系统、Encounter? Conformal?技术和具有SI意识的CeltIC?纳米延迟计算器来设计该芯片。利用SoC Encounter GXL面向成品率的设计特性和可制造性能力,加上虚拟CMP和关键区域分析工具,GUC获得了品质更佳的结果。

    “我们对GUC取得的成功表示祝贺”,负责IC Digital和 Power Forward的Cadence公司副总裁徐季平先生表示,“GUC已经清晰地显示了其高超的设计和实现能力,可以实现当前主流、低功耗设计方法的高级工艺,我们很荣幸能参与其中。”

    GUC在该项设计中使用的许多工具也是Cadence Logic Design Team Solution的一部分,它使用包涵设计和验证的集成和整体方法,通过从计划到闭合的管理和逻辑签收,帮助逻辑设计团队提高了进度可预测性。这代表了Cadence整体策略的另一项可交付部分,为特定的工程师团队提供量身定制的解决方案。

    Crytek公司的总裁Cevat Yerli表示:“我们经常使用NVIDIA的开发者工具来进行性能分析、优化、着色和测试。这些NVIDIA开发者工具在我们开发Crysis的工作中节约了大量的时间和费用。这些工具所具备的超强的调试、可视化和剖析能力保证了它们成为任何开发小组的必备工具。我感到吃惊的是,NVIDA竟然免费提供这些工具。”

    Rockstar San Diego的技术主管Mark Robinson说道:“NVIDIA的开发者工具达到了行业最佳水准,我经常使用FX Composer来快速设计着色器的原型,使用SDK为新技巧带来灵感,并用PerfKit进行详细性能分析和调试。”


 

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